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超大規模集成電路與系統導論
紀錄類型:
書目-電子資源 : 單行本
作者:
尤耶繆拉
出版地:
北京
出版者:
電子工業出版社;
出版年:
2004
集叢名:
國外電子與通信教材系列
標題:
超大規律集成電路 - 教材 - 電路設計 -
標題:
超大規模集成電路 - 教材 - 系統設計 -
電子資源:
中華數字書苑--點擊此處查看電子書全文
附註:
需要下載並安裝APABI Reader軟件閱讀電子圖書
摘要註:
本書介紹CMOS數字大規模集成電路與系統設計的基礎。全書分為三部份。第1部份介紹集成電路的邏輯與物理層設計,其中包括CMOS靜態門的邏輯設計與信號控制,芯片生產與製造工藝,版圖設計與 CAD工具。第2部份討論 CMOS電子電路,介紹 MOSFET的特性和開關模型,各類邏輯電路,包括高速CMOS邏輯電路,同時介紹分析邏輯鏈延時的經典方法和新方法。第3部份為 VLSI的系統設計,介紹 Verilog□ HDL高層次描述語言,分析數字系統單元庫部件以及加法器和乘法器的設計,並且研究物理設計中應當考慮的問題,包括時鐘技術、布局布線、信號串擾、測試與功耗問題。
ISBN:
750539424X
超大規模集成電路與系統導論
尤耶繆拉
超大規模集成電路與系統導論
[電子資源] / (美) 尤耶繆拉著 - 北京 : 電子工業出版社, 2004. - (國外電子與通信教材系列).
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ISBN 750539424X
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超大規模集成電路與系統導論
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本書介紹CMOS數字大規模集成電路與系統設計的基礎。全書分為三部份。第1部份介紹集成電路的邏輯與物理層設計,其中包括CMOS靜態門的邏輯設計與信號控制,芯片生產與製造工藝,版圖設計與 CAD工具。第2部份討論 CMOS電子電路,介紹 MOSFET的特性和開關模型,各類邏輯電路,包括高速CMOS邏輯電路,同時介紹分析邏輯鏈延時的經典方法和新方法。第3部份為 VLSI的系統設計,介紹 Verilog□ HDL高層次描述語言,分析數字系統單元庫部件以及加法器和乘法器的設計,並且研究物理設計中應當考慮的問題,包括時鐘技術、布局布線、信號串擾、測試與功耗問題。
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卷號:
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